Intelの次世代技術について語ろう 91©2ch.net
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Intelの次世代製品や、それに関連する技術についてのスレッドです。
■前スレ
Intelの次世代技術について語ろう 90
http://egg.2ch.net/test/read.cgi/jisaku/1499796238/ プロセスノードごとに2倍という既定のレベルを超えるハイパースケーリングというインテルの新看板
しかしながら具体説明ではロジックトランジスタに限定して高密度化を訴える内容になっており
基礎的な主要回路であるSRAMセルの密度向上は1.6倍に留まる
これはプロセスフィーチャサイズの1.87倍に比べてもかなり控えめな縮小で
配線設計など他のなんらかのファクターが制約として存在する可能性がある
合わせて考えて製品に対するハイパースケーリングの実効的な影響度は不明瞭だ Intelの14nmのハイパフォーマンスロジック向けのセルライブラリはTSMCやSamsungのエセ14/16nmプロセスと比べてもトランジスタ密度高いとは言えないのは有名な話だが
元が低密度なんだからSRAMの向上率を上回る余地があるのは当たり前だろ 誰か、ロジックの密度向上率の方がSRAMより高いことに疑問を持ってるやつはいるのか? >>259
禄なコーディングも出来ない馬鹿が自称プログラマ気取りでドヤ顔トンチンカン書き込みしまくってて
スレ民にコードも書けない癖にと看破されて、反論に馬鹿が自称自作ソースコードをスレに投下したが
間違いだらけで挙げ句の果てにはそのソースコードは無関係の個人サイトからの丸パクリでスレ民に速攻バレして
凄い電波垂れ流しな言い訳して逃げまくってた十年前。
あれから、全く成長してないな
糞 団 子
しねよ。 IDコロコロ変えても君のARM可変長のクソ発言は消えないぞ >>262
お前のものわかりの悪さは絶望的だな
冬には10nmの最初の製品となるCannonLake出るんだから黙っとけよ 故意に論点をすり替えようとしてるのか?
異常な無理解だ やべえ
団子のせいで10nm炎上フラグ立ってもうた AMDが調子こき始めるから転けるのは困る
転けたからってハンダになる訳でもないだろうし 心配しなくとも10nmは当面14nm++よりスイッチ性能悪いのは公式が白状してんだろ
当面10nmが売りにできるのは省電力とトランジスタ密度くらいしかないということ 密度犠牲にして性能に振ってたぶんの貯金を使って本来のスケール率以上の密度向上に振ったけど結果としてスイッチング性能で当面14nm++に負けるというわけよ
代償なんて最初から周知されてるだろ
SRAMの縮小率を根拠に
「2.7倍のスケールなんて出来るはずがない」
とかアホすぎて… 微細化でより低い電圧でもスイッチングできるようになるので電力効率はあがる、だからノートやモバイルSoCには向いている んじゃ、自作民的にはCannonlakeスルーな向きでおk? 高クロックで回すのにカツ入れが必要ってのはあると思います 性能に振ってた分の貯金って何だよw
マジで熱密度ガーって主張したいのかな
どういうテクニックで密度を上げようとしているか、Intelの発表資料を見れば理解できるだろうに
熱密度の要素なんてないぞw >>276
スイッチング性能犠牲にする方向に振ってるんだから貯金を使ったという表現で問題ないだろう 犠牲にすると言っても14nm+よりは速いんだから普通に4GHzオーバーでも使えるレベルなんだよ
全ての問題は歩留まり
当初のロードマップ通り14nm(2015) - 10nm(2016)と移行できてれば何の問題もなかった ダミーフィンを取り除いたりコンタクトの位置を変えることがスイッチング性能を犠牲にすることとどういう原理で結び付くのかご教示願いたいですねえ 14nmではフィンの高さを高くしたり、配線抵抗を下げて段階的に高性能化してきたけど、
これらの手法がダミーフィンの削除やコンタクト位置の変更と言った高密度化の手法と排他的であるとは思えない
単に最初の10nmではそこまで手が回ってないだけでしょうに
>>280
"ダミー"フィンなんだけどw アクティブじゃないフィンはダミーになるって書いてあるよな 10nmが性能犠牲にしてるというか14++が性能のために(14/14+比で)面積犠牲にしてる
というのがIntelの発表から読み取れること >>282
ダミーフィンを減らすと相対的にアクティブフィンが増えて、同じトラックサイズだとスイッチング性能は上がりますが? 高密度のセルライブラリがトラック数が少ないのも各ファウンダリ共通でIntelも例外じゃない
ダミーフィンが何故今まで必要だったのかを逆にに考えてみよう
簡単に言えばIntelは「High Densityライブラリよりに振った」それ以上でもそれ以下でもない
だからこそ7nmや8nmじゃなくて10nm それらしい言葉を並べて煙に巻き始めたなw
10nmになるとどういう原理で性能が犠牲になるのかについての説明や、
今までは熱がボトルネックになってロジック部を小さくできなかったという証拠の提示からは全て逃げてる
まあいつものように妄想だから説明しようがないんだけどw >>288
禄なコーディングも出来ない馬鹿が自称プログラマ気取りでドヤ顔トンチンカン書き込みしまくってて
スレ民にコードも書けない癖にと看破されて、反論に馬鹿が自称自作ソースコードをスレに投下したが
間違いだらけで挙げ句の果てにはそのソースコードは無関係の個人サイトからの丸パクリでスレ民に速攻バレして
凄い電波垂れ流しな言い訳して逃げまくってた十年前。
あれから、全く成長してないな
糞 団 子
しねよ。 おなじダイに2種類のトランジスタ作り分けることができるプロセスがあればいい
速度重視トランジスタ、集積度重視のトランジスタの2つ https://ideone.com/oqpQ8i
これなんでコンパイル通らんのや―。VC通ったのに。 >>292
VCおかしすぎだろ
つかなんでここでやってんだお前 いや、ここの人くわしそうだなって。てへぺろ。
Property(C* Th) :Getter<T,C,Get>(Th), Setter<T,C,Set>(Th) {}
これVC対応してない。。。Orz
さんきゅーそー。 宣言ネームジャマ―ほしいなぁ。そしたら、色々捗るんだけど。
難読的な意味じゃなくて。 VCのconstexprはバグってて通るべきものが通らない >>291
やってるよそれ
そもそもプロセス微細化したら何故消費電力が減るかって、電子の移動距離が小さくなることでより低い電圧でも電流が流れるようになる→消費電力低減
高クロックで動かせばリーク電流は増えるだろう
予定より遅れた上4コア以上のCannonLakeをキャンセルして14nmに置き換えてんだから何のデメリットもなく使えるわけがないんだよな >>299
禄なコーディングも出来ない馬鹿が自称プログラマ気取りでドヤ顔トンチンカン書き込みしまくってて
スレ民にコードも書けない癖にと看破されて、反論に馬鹿が自称自作ソースコードをスレに投下したが
間違いだらけで挙げ句の果てにはそのソースコードは無関係の個人サイトからの丸パクリでスレ民に速攻バレして
凄い電波垂れ流しな言い訳して逃げまくってた十年前。
あれから、全く成長してないな
糞 団 子
しねよ。 週末に2chやるのが唯一の生き甲斐なんや
許したってや >>300
団子がそんなの理解してるわけ無いだろ
いつもの知ったかだよ >>298
上のやつにconstexpr関係ないだろ
また知ったかが始まった >>304
C++のconstexprはテンプレートエンジンをベースに構築されてるから関係なくもないけど 資料をシコシコ作ってる設定は崩壊したしねぇ
自分の作った設定を自分で壊してるからやっぱりアレなんじゃ… お前はスライド仕上げるのに丸一日かけるほど生産性低いの? >207 ,,・´∀`・,,)っ-○○○ >2017/09/09(土) 07:55:56.46 ID:ZSS1mWvi
>まあ今日は勉強会の資料作るからそう相手する気ないから
如何にも生産性の低い奴が言いそうなレスだわなw ガチもんのプレスリリース並みのスライドは1日じゃ終わらんよ
やっぱり世界が狭い
本当にIT業界にいるの? 資料はできるだけ簡素なテキストで済むようにしてる
notepad.exeで作ってA4 1枚に収まるのが理想 >>305
はあ??定数型だからテンプレートと組み合わせること多いだけだろが
こいつ本当に知ったかぶりしかしねえな >>299
> 電子の移動距離が小さくなることでより低い電圧でも電流が流れるようになる
これって
「電界効果トランジスタについて何も理解してないので知ったかぶりします」
って宣言してるに等しいなw / ̄ ̄\
/ _ノ \
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| (__人__)
| ` ⌒´ノ インテルCPUは環境に優しいグリス100%です!
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LGA3647 Xeon・・・グリス ready!
https://twitter.com/momomo_us/status/896530606321946625
LGA2066 Core I9・・・グリス ready!
https://www.techpowerup.com/img/17-05-30/db752c76f7de.jpg
LGA115 Core i7/i5/i3・・・グリス already! >>311
会社経費で落とせないコミュニティの勉強会用のスライドにガチモンのプレスリリースなみの労力かけるとか意味がわからないし
そもそもIT界隈は一人当たり「5分」もザラ
MSKKの澤さんくらいの一流でも「文字の多いスライドはNG」と言ってる
(もちろん時間をかけるなという意味ではない)
知ったようなことをほざくなよ >>313
お前さんがgccやclangのプログラムフロー知らないのわかった >>299へのツッコミに対しては素知らぬ顔をして逃げてますねえ >>320
禄なコーディングも出来ない馬鹿が自称プログラマ気取りでドヤ顔トンチンカン書き込みしまくってて
スレ民にコードも書けない癖にと看破されて、反論に馬鹿が自称自作ソースコードをスレに投下したが
間違いだらけで挙げ句の果てにはそのソースコードは無関係の個人サイトからの丸パクリでスレ民に速攻バレして
凄い電波垂れ流しな言い訳して逃げまくってた十年前。
あれから、全く成長してないな
糞 団 子
しねよ。 そもそもconstexprはenumハックの置き換えを目指したものでテンプレートと独立の機能ではない
実際C++11はテンプレートエンジンを拡張することで対応してたんよ
だから初期のconstexprは末尾再帰みたいな書き方を強いられた
さすがにそれじゃ不便だということで「多少」手が入ったのが14 >>323
駆動電圧と消費電力の因果関係否定されたらいうことねーな >>325
はいはい >>320みたいに適当に名前出してりゃ怯むと思ってんだろ?
constexpr単体で成立する時点で全部間違ってるよお前の言い分
お前ってほんと恥って概念ないよな
平気で大嘘垂れ流すんだから
とっとと死んどけよ こないだ職質されてた江添何某もC++のlambdaがfunctorを自動生成することで成立してるのは知ってる
constexprも内部的にテンプレートの機構を使ってるし
constexprの評価に問題があればテンプレートエンジンにも問題があるということになる アセンブラおじいちゃんの言っていることが何一つ理解できなくて
涙目敗走したからなあ
読める訳ないじゃん https://github.com/gcc-mirror/gcc/blob/gcc-4_7-branch/gcc/cp/semantics.c
団子にはこれが一から宣言してるソースに見えないらしいね?ww
テンプレートエンジンの使い回しだそうでwww
>>330
>本当にコンパイラのソース読んだことないんだな
お前がなwwww テンプレートの不可解な挙動を不可解なままにしないためにはソース読む以上の答えはない
読んで理解できる頭がある事は前提だが あれだけ推してたAVXも上部だけ知ったつもりで
中身は何も知らないんじゃないのかね >>327
何を問題視されてるかも理解してないらしいw
さっさと
「電子が移動する距離が短くなれば低電圧化が可能」
だという理由を動作原理も交えて説明してくださいな
知ったかじゃないと言うならね 読み返したらラムダがfunctorになるのが使いまわしとかww
function-objectの事ならそもそも言語の仕様だろそれww
江添のブログすらまともに読めてねえww 聞かれてもいないことはベラベラ喋るくせに、肝心なことになると黙りで逃走するんだから分かりやすい 最近は自分のから言い出した設定も直ぐに崩壊してるしな
Xeonデュアルのteslaが手に入ったから暫く来ない=卒業だったのに… >>335
あれ?
微細化すすむと電子の移動距離って縮む?
電子って分子間を行き来すると思ってたよ >>346
いや小さくなるっしょ
件の問題は主に素材と断面積が寄与するだけで >>346
FinFetとかTri-gateは寧ろ伸びるんじゃないかな >>349
そいつらが伸ばしてるのは実効チャネル幅Wであってチャネル長Lではない 微細化するとチャネル長が短くなるので、電子の移動距離が短くなるとは言える
だが電子の移動距離とトランジスタに電流が流れ出す電圧であるスレッショルド電圧は基本的に関係ない
スレッショルド電圧は材質や不純物の濃度で決まる >>351
そういう意味じゃなく単純にオーバーオールの移動距離な
かと言ってL成分がモロに影響するような長さにはならんだろうけど 電子って時速3,40cmでカタツムリくらいっての聞いてから、移動ってより伝播って感じなんだよね >>354
ゲート電荷の移動距離の事か?
それともチャネル長の方? 電子の移動距離云々は言い出した団子(>>299)じゃないと本当のところは分からん
多分もう出て来ないだろうけど 速度と電圧に言及してるから多分ゲート電荷だろうけど、移動距離そのものは確かに減ってるが接触面積増えてるから辻褄合わんな
そっちは材料のパラメタ含めたものだし
それよか絶縁膜の性能が問題だわな ■ このスレッドは過去ログ倉庫に格納されています